我搜索了一下,论坛上的资料不多。只有一位交流的比较多,不过好像没有他的邮箱。 请问版主能不能提供点开发信息。 我看了有个并口模拟的头文件例程,是不是按照那里面的函数执行顺序就可以正确写入呢? 谢谢。
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我搜索了一下,论坛上的资料不多。只有一位交流的比较多,不过好像没有他的邮箱。 请问版主能不能提供点开发信息。 我看了有个并口模拟的头文件例程,是不是按照那里面的函数执行顺序就可以正确写入呢? 谢谢。
是的,标准的并口读写时序,我们可以提供时序方面的技术支持。FPGA的DEMO暂时还没有。如果您测试成功,可以降代码贴出。
好的。谢谢!如果有疑问我会请教的